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基于IEEE 802.11a无线局域网标准的OFDM基带处理器设计与硬件实现

作　者: 曲亮
导　师: 王勇；陈抗生
学　校: 浙江大学
专　业: 电磁场与微波技术
关键词: OFDM 基带处理器采样频率同步 FPGA 802.11a
分类号: TN925.93
类　型: 硕士论文
年　份: 2006年
下　载: 619次
引　用: 4次
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内容摘要

正交频分复用(Orthogonal Frequency Division Multiplexing,OFDM)技术由于拥有良好的抗多径性能和较高的频谱利用率成为高速无线通信系统的首选调制技术。因此,对OFDM技术的研究是当前通信领域的热点之一,IEEE 802.11a无线局域网(WLAN)作为典型的采用OFDM作为物理层接入方式的系统以其广泛的应用前景更是受到了极大的关注。本文正是以IEEE 802.11a无线局域网标准为基础,对OFDM基带处理器的算法、架构与具体实现进行了较为深入的研究,完成了整个基带处理器发射部分在寄存器传输级(Register-Transfer Layer,RTL)的完整设计与FPGA实现。整个处理器无论是对功能、时序的后端仿真还是在FPGA上进行的在线实测都体现出了良好的性能。在满足功能要求的同时,本文的设计在整体架构和具体细节描述方面都注重对于最终芯片上物理实现的优化,以提高系统的工作速度并减少硬件资源的消耗。另外,本文还分析了OFDM系统中采样频率偏移对系统性能的影响,基于此提出了一种在频域进行估计和校正的采样频率同步算法。该算法非常易于硬件实现,与采用最小二乘法(Least Square,LS)的估计算法相比可以减少20%的硬件资源,提高1倍的工作速度。为了证明算法的有效性,本文根据IEEE 802.11a无线局域网标准进行了算法仿真和FPGA上的硬件实现研究。仿真结果表明无论是在高斯白噪声(Additive While Gaussian Noise,AWGN)信道还是多径信道下该算法均可以有效地对采样频偏进行校正,使系统性能符合标准要求;通过在FPGA上的硬件实现以及使用Xilinx的Chipscop Pro进行的在线实时验证表明,该算法可以在占用较少硬件资源的条件下,实时、连续地对信号进行处理,从而作为一个完整OFDM基带处理器接收端的子模块很好地工作。

全文目录

摘要  3-4
ABSTRACT  4-5
致谢  5-6
目录  6-8
图片目录  8-10
表格目录  10-11
第一章绪论  11-26
  1．1 无线通信系统简介  11-15
    1．1．1 无线通信系统现状  11-12
    1．1．2 无线宽带接入系统  12-14
    1．1．3 单载波与多载波通信系统  14-15
  1．2 OFDM系统发展历史  15-17
    1．2．1 发展历史  15-16
    1．2．2 应用现状  16-17
  1．3 OFDM系统的主要特点  17-19
  1．4 OFDM系统的基本原理  19-25
    1．4．1 OFDM系统的数学模型  19-21
    1．4．2 FFT在OFDM系统中的应用  21-22
    1．4．3 保护间隔与循环前缀  22-24
    1．4．4 OFDM系统架构  24-25
  1．5 本文的主要工作  25-26
第二章 IEEE 802．11a协议  26-40
  2．1 无线局域网标准概述  26-28
  2．2 IEEE 802．11无线局域网的介质访问控制(MAC)  28-29
  2．3 IEEE 802．11a物理层协议  29-40
    2．3．1 主要参数  29-33
    2．3．2 信道构成  33-34
    2．3．3 物理层协议数据单元(PPDU)帧结构  34-40
第三章 OFDM基带处理器发射部分设计  40-64
  3．1 OFDM基带处理器发射端总体架构  41-43
  3．2 训练序列生成模块  43-46
  3．3 SIGNAL符号生成模块  46-51
    3．3．1 模块架构  46
    3．3．2 输入缓存  46-47
    3．3．3 1/2卷积编码  47-48
    3．3．4 交织  48-49
    3．3．5 BPSK调制  49-50
    3．3．6 导频插入  50-51
  3．4 DATA符号生成模块  51-54
    3．4．1 扰码  52
    3．4．2 多码率卷积编码  52-53
    3．4．3 交织  53-54
  3．5 IFFT处理模块  54-57
    3．5．1 FFT core  54-56
    3．5．2 硬件实现  56-57
  3．6 循环前级添加与加窗处理模块  57
  3．7 主控制单元  57-59
  3．8 时钟生成模块  59-61
  3．9 整个发射处理器  61-64
第四章采样频率同步算法研究  64-80
  4．1 OFDM基带处理器接收部分总体架构  64-67
  4．2 信道模型  67-70
  4．3 采样频率同步算法  70-80
    4．3．1 采样频率偏移对OFDM系统性能的影响  71-73
    4．3．2 采样频率同步算法分析  73-76
    4．3．3 算法性能仿真  76-80
第五章接收处理器采样频率同步模块设计  80-89
  5．1 接收处理器采样频率同步模块实现方案  80-82
  5．2 数据缓存与导频提取  82
  5．3 导频相关  82-83
  5．4 采样频偏估计  83-85
  5．5 采样频偏补偿  85-86
  5．6 设计性能分析  86-89
第六章结束语  89-91
  6．1 结论  89
  6．2 未来目标  89-91
第七章参考文献  91-95

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