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高速数据链路中同步技术研究与FPGA实现

作　者: 解志强
导　师: 刘晓明
学　校: 重庆大学
专　业: 电路与系统
关键词: 编码正交频分复用同步 Turbo码 FPGA
分类号: TN919.3
类　型: 硕士论文
年　份: 2011年
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内容摘要

编码正交频分复用COFDM(Coded Orthogonal Frequency Division Multiplexing)系统将OFDM技术与信道编解码技术相结合,它既具备OFDM技术频谱效率高,抗多径衰落能力强,抗窄带干扰性能好等众多突出的优势,又兼备信道编解码技术的高编码增益,因此COFDM技术作为未来无线通信的关键技术而成为当今研究的热点。但COFDM技术对频偏、定时和相位噪声敏感,较小的同步偏差即会导致系统的误码性能恶化,同时高编码增益的编解码技术硬件实现复杂度大,因此同步性能和编码性能的好坏直接影响到COFDM系统的数据传输性能。本文简要介绍了COFDM技术的发展历史与研究现状,详细阐述了COFDM技术的基本原理、特点及技术优势,以高速航空下行数据链项目为背景,设计了一套完整的COFDM物理层方案。详细的推导并仿真了各种同步误差对系统性能的影响,仿真分析评估了各种同步算法的性能,详细的推导了Turbo码的译码算法并通过仿真比较译码性能,保证算法性能的基础上,选择出了适合硬件实现的算法。以系统方案中的参数为基础,在充分考虑算法的性能及实现复杂度的基础上,设计了一整套COFDM系统的结构,包括同步和译码部分。详细描述了同步系统中各种同步算法的硬件实现结构,提出了一种基于导频的残余相位与信道频率响应的联合估计与补偿算法,在保证估计性能的同时,显著的降低了系统实现的复杂度;针对Turbo译码器迭代过程复杂且存储量需求大的问题,提出了新型存储器调度方案,设计了新型译码结构,比传统译码结构节省了一半的存储资源。用verilog HDL语言实现了COFDM系统基带部分的硬件描述,用Modelsim软件针对COFDM的基带收发处理系统进行了仿真验证,证明了电路逻辑的可行性。介绍了一种中频数字接收机的实现方法,设计了COFDM系统中频数字收发机的硬件平台,将电路逻辑与硬件平台相结合最终完成了COFDM系统的样机,在实验室环境下对此样机进行了测试,给出了多个关键电路的硬件测试效果,测试结果表明COFDM系统基本达到项目要求。

全文目录

中文摘要  3-4
英文摘要  4-8
1 绪论  8-12
  1.1 研究的背景和意义  8
  1.2 OFDM 技术及发展现状  8-9
  1.3 OFDM 系统中的Turbo 码应用  9-10
  1.4 本文的主要工作  10-12
2 COFDM 系统的基本原理  12-26
  2.1 无线信道  12-13
    2.1.1 信道衰落  12
    2.1.2 多径效应  12-13
    2.1.3 多普勒频移  13
  2.2 OFDM 原理  13-17
    2.2.1 OFDM 数学模型  13-15
    2.2.2 OFDM 的保护间隔  15-17
  2.3 Turbo 码原理  17-18
  2.4 COFDM 系统  18-24
    2.4.1 COFDM 系统模型  18-19
    2.4.2 COFDM 系统参数  19-20
    2.4.3 帧格式  20-22
    2.4.4 导频插入方式  22-23
    2.4.5 子载波调制映射  23-24
  2.5 本章小结  24-26
3 COFDM 系统的同步与译码技术  26-58
  3.1 同步概述  26-27
  3.2 同步误差对系统性能的影响  27-35
    3.2.1 同步误差分析  27-30
    3.2.2 载波同步偏差的影响  30-32
    3.2.3 符号定时同步偏差的影响  32-33
    3.2.4 采样同步偏差的影响  33-35
  3.3 同步算法与仿真  35-47
    3.3.1 时域符号粗同步算法  35-42
    3.3.2 频域符号细同步算法  42-43
    3.3.3 时域频率同步  43-45
    3.3.4 频域频偏估计  45-46
    3.3.5 相位跟踪  46-47
  3.4 Turbo 译码算法与仿真  47-56
    3.4.1 MAP 算法  49-52
    3.4.2 Log-MAP 算法  52-54
    3.4.3 Max-Log-MAP 算法  54
    3.4.4 SOVA 算法  54
    3.4.5 Turbo 码性能仿真  54-56
  3.5 本章小结  56-58
4 COFDM 系统的中频数字接收机实现  58-80
  4.1 COFDM 接收机系统  58-59
  4.2 中频数字接收机理论  59-61
  4.3 同步系统的FPGA 实现  61-68
    4.3.1 COFDM 粗符号定时同步  61-64
    4.3.2 时域频偏估计  64-66
    4.3.3 细符号定时与采样定时的联合估计  66-67
    4.3.4 残余相位跟踪和信道估计  67-68
  4.4 译码系统的FPGA 实现  68-72
    4.4.1 解调结果软输出  68-69
    4.4.2 译码器设计与实现  69-72
  4.5 系统硬件及测试  72-78
    4.5.1 COFDM 系统中频发射机  73-75
    4.5.2 COFDM 系统中频数字接收机  75-78
  4.6 本章小结  78-80
5 总结与展望  80-82
  5.1 论文总结  80-81
  5.2 后续研究工作展望  81-82
致谢  82-84
参考文献  84-86
附录  86
  A. 作者在攻读学位期间发表的论文目录  86
  B. 作者在攻读学位期间取得的科研成果目录  86

高速数据链路中同步技术研究与FPGA实现

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