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静止和活动图像一体化压缩编码算法及硬件实现研究

作　者: 裘陆君
导　师: 李云松
学　校: 西安电子科技大学
专　业: 通信与信息系统
关键词: JPEG2000 运动估计 ADV202 ADSP-TS201
分类号: TN919.81
类　型: 硕士论文
年　份: 2011年
下　载: 34次
引　用: 1次
阅　读: 论文下载

内容摘要

随着信息技术的快速发展,人们对于多媒体通信提出了更高的要求。在很多场合中往往需要一个系统能同时处理低分辨率的视频图像和高分辨率的静止图像,然而不同类型的图像必须采用不同的压缩方式才能获得最优的压缩效果,这对有限的硬件资源提出了严峻的考验。本文结合国内外图像压缩技术的发展趋势,在已有的图像压缩理论基础上,深入研究了静止和活动图像一体化压缩编码算法,提出并完成了一套静止和活动图像一体化压缩算法的硬件实现方案。本系统采用JPEG2000专用编解码芯片ADV202负责基于小波变换的静止图像压缩,采用高处理性能芯片ADSP-TS201负责活动图像压缩中的运动估计,结合静止图像压缩和活动图像压缩的特点,实现了在同一个系统中支持静止和活动图像的实时压缩编码处理。系统支持静止图像的无损和有损压缩,且压缩比在线可调,同时支持活动图像压缩的码率精确可控。

全文目录

摘要  3-4
Abstract  4-7
第一章绪论  7-11
  1.1 引言  7
  1.2 选题背景  7-8
  1.3 国内外研究概况  8-9
  1.4 本文研究目的及主要内容  9-11
第二章图像压缩编码算法  11-21
  2.1 图像压缩的基本原理  11-13
  2.2 静止图像编码标准  13-16
    2.2.1 JPEG 标准  13
    2.2.2 JPEG2000 标准  13-16
  2.3 活动图像编码标准  16-20
    2.3.1 活动图像压缩编码原理  16-18
    2.3.2 H.264 编码算法  18-20
  2.4 本章小结  20-21
第三章一体化压缩编码算法  21-31
  3.1 一体化算法的系统原理  21-22
  3.2 一体化算法的关键技术  22-30
    3.2.1 最优小波基的选择方法  22-25
    3.2.2 基于预测的方向提升小波变换  25-27
    3.2.3 基于块匹配的快速运动估计技术  27-30
  3.3 本章小结  30-31
第四章一体化压缩编码算法的硬件实现  31-57
  4.1 一体化系统的硬件结构  31-34
  4.2 静止图像压缩模块设计  34-42
    4.2.1 ADV202 的性能介绍及初始化配置  34-38
    4.2.2 ADV202 控制器的FPGA 实现  38-41
    4.2.3 ADV202 与FPGA 的接口设计  41-42
  4.3 活动图像压缩模块设计  42-48
    4.3.1 视频源的输入模块设计  43
    4.3.2 码流复合模块  43-45
    4.3.3 DSP 与FPGA 的链路口设计  45-48
  4.4 系统性能测试  48-55
    4.4.1 静止图像压缩性能测试  49-52
    4.4.2 活动图像压缩性能测试  52-55
  4.5 本章小结  55-57
第五章结束语  57-59
致谢  59-61
参考文献  61-63
研究成果  63-64

静止和活动图像一体化压缩编码算法及硬件实现研究

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